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2011-02-02

verilog-mode for xyzzy


ソフトウェアの世界のヒトはたぶん聞いたこともないと思われますが、
Verilog-HDL という言語があります。ハードウェア記述言語というもので、
LSI のロジックをプログラムみたいに書くことができる、というシロモノです。
一般に、プログラミング言語のソースコードをコンパイルすると実行ファイルや
ライブラリ(DLL とか)が得られますが、ハードウェア記述言語のソースコードを
コンパイルすると回路図が得られます。最近は SystemVerilog が主流なのかも。

で、ハードウェア記述言語と言ってもソースコードを書くときはエディタのお世話になります。
世の中にはこんなマイナーな言語をサポートしてくれるエディタなんてほとんど無いんですが、
無いなら作ればいいんです。そう、xyzzy とか Emacs ならそれができる!

ちょっと調べてみたところ、xyzzy 向けの verilog-mode が公開されていました。

    ⇒ http://www.oct-net.ne.jp/~mayu-a/xyzzy.html

さっそく使わせていただいたのですが、ちょっと手になじまないところがあったので、
勝手に改造させていただきました。

で、できたファイル一式をここで公開しておきます。

    ⇒ verilog-mode の勝手に改造版

よろしければお使いください。

ちなみに、数年前に作って放置されてたものなので、
おかしなところがあるかもしれませんが、まぁ、
ご報告いただければたぶん修正します。

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